曙海教育集團
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       每期人數(shù)限3到5人。
   上課時間和地點
上課地點：【上?！浚和瑵髮W(滬西)/新城金郡商務樓(11號線白銀路站) 【深圳分部】：電影大廈(地鐵一號線大劇院站)/深圳大學成教院 【北京分部】：北京中山學院/福鑫大樓 【南京分部】：金港大廈(和燕路) 【武漢分部】：佳源大廈（高新二路） 【成都分部】：領館區(qū)1號（中和大道） 【沈陽分部】：沈陽理工大學/六宅臻品 【鄭州分部】：鄭州大學/錦華大廈 【石家莊分部】：河北科技大學/瑞景大廈 【廣州分部】：廣糧大廈 【西安分部】：協(xié)同大廈
最近開課時間(周末班/連續(xù)班/晚班）：2020年3月16日
   實驗設備
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   質量保障

        1、培訓過程中，如有部分內容理解不透或消化不好，可免費在以后培訓班中重聽；
        2、培訓結束后,授課老師留給學員聯(lián)系方式,保障培訓效果,免費提供課后技術支持。
        3、培訓合格學員可享受免費推薦就業(yè)機會。
課程大綱
 
  1. 使用6系列FPGA產品進行設計培訓之利用 Spartan-6 和 V
    使用6系列FPGA產品進行設計培訓之
    利用 Spartan-6 和 Virtex-6 系列進行設計培訓
    課程概要
    1
    Spartan-6 FPGA 簡介
    Virtex-6 FPGA 簡介
    CLB 架構
    HDL 編碼技術
    實驗1：CLB 資源
    存儲器資源
    DSP 資源
    2
    實驗2：DSP 資源
    基本 I/O 資源
    Spartan-6 FPGA I/O 資源
    Virtex-6 FPGA I/O 資源
    實驗3：I/O 資源
    基本時鐘控制資源
    3
    Spartan-6 FPGA 時鐘控制資源
    Virtex-6 FPGA 時鐘控制資源
    實驗4：時鐘控制資源
    存儲器控制器
    專用硬件
    ? Spartan-6 系列課程概要
    1
    Spartan-6 FPGA 簡介
    CLB 架構
    HDL 編碼技術
    實驗1：CLB 資源
    存儲器資源
    DSP 資源
    實驗2：DSP 資源
    基本 I/O 資源
    Spartan-6 FPGA I/O 資源
    2
    實驗3：I/O 資源
    基本時鐘控制資源
    Spartan-6 FPGA 時鐘控制資源
    實驗4：時鐘控制資源
    存儲器控制器
    專用硬件
    Virtex-6 系列課程概要
    1
    Virtex-6 FPGA 簡介
    CLB 架構
    HDL 編碼技術
    實驗1：CLB 資源
    存儲器資源
    DSP 資源
    實驗2：DSP 資源
    基本 I/O 資源
    2
    Virtex-6 FPGA I/O 資源
    實驗3：I/O 資源
    基本時鐘控制資源
    Virtex-6 FPGA 時鐘控制資源
    實驗4：時鐘控制資源
    存儲器控制器
    專用硬件

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